blob: cddbbb27fc99f89789b2fc14235cbdf3c22b0825 [file] [log] [blame]
Marek Vasut952caa22015-06-21 17:28:53 +02001/*
2 * Altera SoCFPGA PinMux configuration
3 *
4 * SPDX-License-Identifier: BSD-3-Clause
5 */
6
7#ifndef __SOCFPGA_PINMUX_CONFIG_H__
8#define __SOCFPGA_PINMUX_CONFIG_H__
9
10const u8 sys_mgr_init_table[] = {
11 0, /* EMACIO0 */
12 2, /* EMACIO1 */
13 2, /* EMACIO2 */
14 2, /* EMACIO3 */
15 2, /* EMACIO4 */
16 2, /* EMACIO5 */
17 2, /* EMACIO6 */
18 2, /* EMACIO7 */
19 2, /* EMACIO8 */
20 0, /* EMACIO9 */
21 2, /* EMACIO10 */
22 2, /* EMACIO11 */
23 2, /* EMACIO12 */
24 2, /* EMACIO13 */
25 0, /* EMACIO14 */
26 0, /* EMACIO15 */
27 0, /* EMACIO16 */
28 0, /* EMACIO17 */
29 0, /* EMACIO18 */
30 0, /* EMACIO19 */
31 3, /* FLASHIO0 */
32 0, /* FLASHIO1 */
33 3, /* FLASHIO2 */
34 3, /* FLASHIO3 */
35 0, /* FLASHIO4 */
36 0, /* FLASHIO5 */
37 0, /* FLASHIO6 */
38 0, /* FLASHIO7 */
39 0, /* FLASHIO8 */
40 3, /* FLASHIO9 */
41 3, /* FLASHIO10 */
42 3, /* FLASHIO11 */
43 0, /* GENERALIO0 */
44 1, /* GENERALIO1 */
45 1, /* GENERALIO2 */
46 1, /* GENERALIO3 */
47 1, /* GENERALIO4 */
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87 2, /* MIXED1IO12 */
88 2, /* MIXED1IO13 */
89 0, /* MIXED1IO14 */
90 3, /* MIXED1IO15 */
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97 0, /* MIXED2IO0 */
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110 0, /* GPLINMUX53 */
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112 0, /* GPLINMUX55 */
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128 1, /* GPLMUX0 */
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130 1, /* GPLMUX2 */
131 1, /* GPLMUX3 */
132 1, /* GPLMUX4 */
133 1, /* GPLMUX5 */
134 1, /* GPLMUX6 */
135 1, /* GPLMUX7 */
136 1, /* GPLMUX8 */
137 1, /* GPLMUX9 */
138 1, /* GPLMUX10 */
139 1, /* GPLMUX11 */
140 1, /* GPLMUX12 */
141 1, /* GPLMUX13 */
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143 1, /* GPLMUX15 */
144 1, /* GPLMUX16 */
145 1, /* GPLMUX17 */
146 1, /* GPLMUX18 */
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148 1, /* GPLMUX20 */
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150 1, /* GPLMUX22 */
151 1, /* GPLMUX23 */
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153 1, /* GPLMUX25 */
154 1, /* GPLMUX26 */
155 1, /* GPLMUX27 */
156 1, /* GPLMUX28 */
157 1, /* GPLMUX29 */
158 1, /* GPLMUX30 */
159 1, /* GPLMUX31 */
160 1, /* GPLMUX32 */
161 1, /* GPLMUX33 */
162 1, /* GPLMUX34 */
163 1, /* GPLMUX35 */
164 1, /* GPLMUX36 */
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179 1, /* GPLMUX51 */
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182 1, /* GPLMUX54 */
183 1, /* GPLMUX55 */
184 1, /* GPLMUX56 */
185 1, /* GPLMUX57 */
186 1, /* GPLMUX58 */
187 1, /* GPLMUX59 */
188 1, /* GPLMUX60 */
189 1, /* GPLMUX61 */
190 1, /* GPLMUX62 */
191 1, /* GPLMUX63 */
192 1, /* GPLMUX64 */
193 1, /* GPLMUX65 */
194 1, /* GPLMUX66 */
195 1, /* GPLMUX67 */
196 1, /* GPLMUX68 */
197 1, /* GPLMUX69 */
198 1, /* GPLMUX70 */
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201 0, /* RGMII1USEFPGA */
202 0, /* SPIS0USEFPGA */
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204 0, /* I2C0USEFPGA */
205 0, /* SDMMCUSEFPGA */
206 0, /* QSPIUSEFPGA */
207 0, /* SPIS1USEFPGA */
208 0, /* RGMII0USEFPGA */
209 0, /* UART1USEFPGA */
210 0, /* CAN1USEFPGA */
211 0, /* USB1USEFPGA */
212 0, /* I2C3USEFPGA */
213 0, /* I2C2USEFPGA */
214 0, /* I2C1USEFPGA */
215 0, /* SPIM1USEFPGA */
216 0, /* USB0USEFPGA */
217 0 /* SPIM0USEFPGA */
218};
219#endif /* __SOCFPGA_PINMUX_CONFIG_H__ */