| /* SPDX-License-Identifier: GPL-2.0-only */ |
| /* |
| * Copyright (c) 2015, The Linux Foundation. All rights reserved. |
| */ |
| |
| #ifndef _DT_BINDINGS_CLK_MSM_GCC_8996_H |
| #define _DT_BINDINGS_CLK_MSM_GCC_8996_H |
| |
| #define GPLL0_EARLY 0 |
| #define GPLL0 1 |
| #define GPLL1_EARLY 2 |
| #define GPLL1 3 |
| #define GPLL2_EARLY 4 |
| #define GPLL2 5 |
| #define GPLL3_EARLY 6 |
| #define GPLL3 7 |
| #define GPLL4_EARLY 8 |
| #define GPLL4 9 |
| #define SYSTEM_NOC_CLK_SRC 10 |
| /* U-Boot: KConfig check in CI erroneously picks this up, it's unused |
| * anyway so comment it out for now |
| */ |
| //#define CONFIG _NOC_CLK_SRC 11 |
| #define PERIPH_NOC_CLK_SRC 12 |
| #define MMSS_BIMC_GFX_CLK_SRC 13 |
| #define USB30_MASTER_CLK_SRC 14 |
| #define USB30_MOCK_UTMI_CLK_SRC 15 |
| #define USB3_PHY_AUX_CLK_SRC 16 |
| #define USB20_MASTER_CLK_SRC 17 |
| #define USB20_MOCK_UTMI_CLK_SRC 18 |
| #define SDCC1_APPS_CLK_SRC 19 |
| #define SDCC1_ICE_CORE_CLK_SRC 20 |
| #define SDCC2_APPS_CLK_SRC 21 |
| #define SDCC3_APPS_CLK_SRC 22 |
| #define SDCC4_APPS_CLK_SRC 23 |
| #define BLSP1_QUP1_SPI_APPS_CLK_SRC 24 |
| #define BLSP1_QUP1_I2C_APPS_CLK_SRC 25 |
| #define BLSP1_UART1_APPS_CLK_SRC 26 |
| #define BLSP1_QUP2_SPI_APPS_CLK_SRC 27 |
| #define BLSP1_QUP2_I2C_APPS_CLK_SRC 28 |
| #define BLSP1_UART2_APPS_CLK_SRC 29 |
| #define BLSP1_QUP3_SPI_APPS_CLK_SRC 30 |
| #define BLSP1_QUP3_I2C_APPS_CLK_SRC 31 |
| #define BLSP1_UART3_APPS_CLK_SRC 32 |
| #define BLSP1_QUP4_SPI_APPS_CLK_SRC 33 |
| #define BLSP1_QUP4_I2C_APPS_CLK_SRC 34 |
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| #define BLSP1_UART5_APPS_CLK_SRC 38 |
| #define BLSP1_QUP6_SPI_APPS_CLK_SRC 39 |
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| #define GCC_MSS_GPLL0_DIV_CLK 229 |
| |
| #define GCC_SYSTEM_NOC_BCR 0 |
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| #define GCC_QDSS_BCR 6 |
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| #define GCC_CNOC_BUS_TIMEOUT2_BCR 67 |
| #define GCC_CNOC_BUS_TIMEOUT3_BCR 68 |
| #define GCC_CNOC_BUS_TIMEOUT4_BCR 69 |
| #define GCC_CNOC_BUS_TIMEOUT5_BCR 70 |
| #define GCC_CNOC_BUS_TIMEOUT6_BCR 71 |
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| #define GCC_CNOC_BUS_TIMEOUT8_BCR 73 |
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| #define GCC_CNOC_BUS_TIMEOUT_EXTREF_BCR 75 |
| #define GCC_APB2JTAG_BCR 76 |
| #define GCC_RBCPR_CX_BCR 77 |
| #define GCC_RBCPR_MX_BCR 78 |
| #define GCC_PCIE_0_BCR 79 |
| #define GCC_PCIE_0_PHY_BCR 80 |
| #define GCC_PCIE_1_BCR 81 |
| #define GCC_PCIE_1_PHY_BCR 82 |
| #define GCC_PCIE_2_BCR 83 |
| #define GCC_PCIE_2_PHY_BCR 84 |
| #define GCC_PCIE_PHY_BCR 85 |
| #define GCC_DCD_BCR 86 |
| #define GCC_OBT_ODT_BCR 87 |
| #define GCC_UFS_BCR 88 |
| #define GCC_SSC_BCR 89 |
| #define GCC_VS_BCR 90 |
| #define GCC_AGGRE0_NOC_BCR 91 |
| #define GCC_AGGRE1_NOC_BCR 92 |
| #define GCC_AGGRE2_NOC_BCR 93 |
| #define GCC_DCC_BCR 94 |
| #define GCC_IPA_BCR 95 |
| #define GCC_QSPI_BCR 96 |
| #define GCC_SKL_BCR 97 |
| #define GCC_MSMPU_BCR 98 |
| #define GCC_MSS_Q6_BCR 99 |
| #define GCC_QREFS_VBG_CAL_BCR 100 |
| #define GCC_PCIE_PHY_COM_BCR 101 |
| #define GCC_PCIE_PHY_COM_NOCSR_BCR 102 |
| #define GCC_USB3_PHY_BCR 103 |
| #define GCC_USB3PHY_PHY_BCR 104 |
| #define GCC_MSS_RESTART 105 |
| |
| /* Indexes for GDSCs */ |
| #define AGGRE0_NOC_GDSC 0 |
| #define HLOS1_VOTE_AGGRE0_NOC_GDSC 1 |
| #define HLOS1_VOTE_LPASS_ADSP_GDSC 2 |
| #define HLOS1_VOTE_LPASS_CORE_GDSC 3 |
| #define USB30_GDSC 4 |
| #define PCIE0_GDSC 5 |
| #define PCIE1_GDSC 6 |
| #define PCIE2_GDSC 7 |
| #define UFS_GDSC 8 |
| |
| #endif |